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人人好公，则天下太平；人人营私，则天下大乱。——刘鹗
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分析设计计算：
1.CPU结构如图1所示，其中有一个累加寄存器AC，一个状态条件寄存器，各
部分之间的连线表示数据通路，箭头表示信息传送方向。
（1）标明图中四个寄存器的名称。
（2）简述指令从主存取到控制器的数据通路。
（3）简述数据在运算器和主存之间进行存/取访问的数据通路。
图1
解：
（1）a为数据缓冲寄存器DR，b为指令寄存器IR，c为主存地址寄存器，
d为程序计数器PC。
（2）主存M→缓冲寄存器DR→指令寄存器IR→操作控制器。
（3）存贮器读：M→缓冲寄存器DR→ALU→AC
存贮器写：AC→缓冲寄存器DR→M
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人人好公，则天下太平；人人营私，则天下大乱。——刘鹗
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2.某机器中，配有一个ROM芯片，地址空间0000H—3FFFH。现在再用几个
16K8的芯片构成一个32K8的RAM区域，使其地址空间为8000H—
××
FFFFH。假设此RAM芯片有/CS和/WE信号控制端。CPU地址总线为A15——
A15
A0,数据总线为D7——D0,控制信号为R//W，MREQ(存储器请求)，当且仅当MREQ
D7
和R//W同时有效时，CPU才能对有存储器进行读(或写)。
（1）满足已知条件的存储器，画出地址码方案。
（2）画出此CPU与上述ROM芯片和RAM芯片的连接图。
解：存储器地址空间分布如图1所示，分三组，每组16K××8位。
16K
由此可得存储器方案要点如下：
（1）用两片16K*8RAM芯片位进行串联连接，构成32K*8的RAM区
——AA，片选地址为：A——AA；
域。片内地址：A————
0131415
（2）译码使用2：4译码器；
（3）用/MREQ作为2：4译码器使能控制端，该信号低电平（有效）
时，译码器工作。
（4）CPU的R//W信号与RAM的/WE端连接，当R//W=1时存储
器执行读操作，当R//W=0时，存储器执行写操作。如图1
0000ROM
3FFF16K*8
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