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（2）状态化简：将电路中的等效状态合并为一个状态；
n−1n
（3）重新确定电路状态数N，并求出触发器数：；
2N2
（4）选择触发器类型（D.JK）；
（5）勒出状态转换表，求状态方程、驱动方程；
（6）画时序电路图；
（7）时序状态检验，应进行自启动检验，以免电路进入无效状态而
不能自启动；
（8）功能仿真，时序仿真。
三、实验仪器
1、直流稳压电源1台
2、任意波信号发生器1台
3、数字万用表1台
4、电子技术综合试验箱1台
5、数字示波器1台
四、实验内容
1、自拟实验步骤，验证与非型直接RS触发器、D触发器、
JK触发器逻辑功能；
实验前进行检测，检查器件无问题后才开始实验。
2、设计同步模5（421码）加法计数器逻辑电路（采用JK触
发器设计）
设计过程：
状态转换表如图所示
nnnn+1n+1n+1Y
QQQQQQ
321321
0000010
0010100
0100110
0111000
1000001
其他
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