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实验十九。十进制计数器CD4017--第1页
实验十九、十进制计数器CD4017逻
辑功能测试
一、实验目的
1、学习用集成触发器构成计数器的方法
2、掌握中规模集成计数器的使用及其测试方法
3、掌握CD4017计数器的逻辑功能及使用方法
二、实验预习要求
1、复习有关计数器部分内容
2、拟出各实验内容所需的测试记录表格
3、查手册，给出并熟悉实验所用各集成的引脚排列及逻辑功能。
三、实验设备与器件
1、+5V直流电源2、双踪示波器3、连续脉冲源
4、单次脉冲源5、逻辑电平开关6、逻辑电平显示器7、译
码显示器8、CD4017B
四、实验原理
1、计数器是一个用以实现计数功能的时序部件，它不仅可用来计
数脉冲数，还常用作数字系统定时、分频和执行数字运算以及其他特
定的逻辑功能。
计数器种类很多，按构成计数器中的各触发器是否使用一个时钟
脉冲源来分，有同步计数器和异步计数器。根据计数制的不同，分为
二进制计数器，十进制计数器和任意进制计数器。根据计数的增减趋
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势，又分为加法、减法和可逆计数器。还有可预置数和可编程序功能
计数器等。目前，无论是TTL还是CMOS集成电路，都有品种较齐
全的中规模集成计数器。
2、中规模十进制计数器
CD4017B有清除和置数等功能，其引脚排列及逻辑符号如
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CD4017：十进制计数器/脉
冲分配器CD4017是5位Johnson计数器，具有10个译码输出端，
CP、CR、INH输入端。时钟输入端的斯密特触发器具有脉冲整形功
能，对输入时钟脉冲上升和下降时间无限制。INH为低电平时，计
Q1-Q9(Pin3，2，4，7，10，1，5，6，9，11)，为解码后的时进制输
出接脚，被计数到的值，其输出为Hi，其余为Lo电位。b、CARRYOUT
数器在时钟上升沿计数；反之，计数功能无效。CR为高电平时，计
数器清零。CD4017有16支脚，除电源脚VDD及VSS为电源接脚，
输入电压范围为3–15V之外，其余接脚为：A、频率输入脚：
CLOCK(Pin14)，为频率信号的输入脚。B、数据输出脚：a、（Pin12），
进位脚，当4017计数10个脉冲之后，CARRYOUT将输出一个脉波，
代表产生进位，共串级计数器使用。D、控制脚：a、CLEAR(Pin15)：
清除脚或称复位(Reset)脚，当此脚为Hi时，会使CD4017的Q0为”1”，
其余Q1-Q9为”0”。b、CLOCKENABLE(Pin13)，时序允许脚，当
此脚为低电位，CLOCK输入脉波在正缘时，会使CD4017计数，并改
变Q1-Q9的输出状态。
在clk有效沿的作用下Q0~Q9依次输出一个正脉冲
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