使用XST综合设计课件.pptVIP

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2025-02-09 发布于未知
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使用XST綜合設計5.1.2使用XST綜合設計1.綜合設計My_cou在3.1.3節中我們使用StateCAD設計了一個計數器，並且將StateCAD生成的VHDL代碼加入工程。現在，使用ISE5.2內嵌的綜合工具XST進行綜合設計，並且從不同的角度瞭解綜合後的電路結構。5.1.2使用XST綜合設計（1）打開工程StateCAD。（2）單擊滑鼠選中My_cou模組，使其處於高亮狀態。（3）在ProcessForcurrentSources中雙擊Synthesize圖示，此時在Transcript(腳本窗口)中可以看到XST的綜合流程和相關報告。5.1.2使用XST綜合設計（4）如果綜合成功，Synthesize圖示左邊會出現，綜合失敗為，如果有某種警告則出現。如果發現錯誤，綜合無法通過。如果發現警告，設計者應該提高警惕。2．查看綜合報告綜合後，XST會提供綜合報告。雙擊滑鼠左鍵，顯示綜合報告綜合報告從My_cou的綜合報告中截取的報告左邊是HDLSynthesis報告，從報告可以知道綜合My_cou模組用到了7個D觸發器和一個加法器。其中輸出dout0,dout1,dout2,dout3各佔用一個D觸發器，三個狀態idle,cou,stop各佔用一個D觸發器。左邊是Deviceutilizationsummary報告，由報告可以知道，設計佔用了9個切片（Slices）組織，使用了7個觸發器、16個4輸入可查找表結構（LUT），佔用晶片6個IOB和一個全局時鐘引腳（GCLK）。3.查看RTL視圖ISE5.2比以前的版本增加了一些功能，其中非常有用的是在綜合後，提供了查看RTL視圖工具（XilinxECS）。此功能可以讓設計者非常清楚的看到設計的寄存器級的原理圖，從而使設計者能將HDL代碼和實際電路有效的聯繫起來，更容易發現問題和解決問題，提高設計效率。3.查看RTL視圖首先選中要查看RTL視圖的檔My_cou，然後在ProcessForCurrentSources中Synthesize圖示的子菜單中單擊ViewRTLSchematic圖示可以啟動XilinxECS工具。雙擊顯示內部結構