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集成电路设计中的时钟和数据到达时间约束考核试卷
考生姓名：答题日期：得分：判卷人：
本次考核旨在评估考生对集成电路设计中时钟和数据到达时间约束的理解与掌握程度，包括时钟域划分、时序约束设置、路径延迟计算等方面的知识，以检验考生在实际设计中的应用能力。
一、单项选择题（本题共30小题，每小题0.5分，共15分，在每小题给出的四个选项中，只有一项是符合题目要求的）
1.时钟域划分的主要目的是什么？
A.减少时钟域切换时的功耗
B.提高时钟频率
C.减少时钟网络延迟
D.以上都是
2.以下哪个不是时钟域切换中可能遇到的问题？
A.时钟抖
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